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Internal Block Diagram
V PP
V CC
V REG
V SS
V REGA
IIR
Offset
V SSA
Over-Damped
SINC Filter
Low-Pass Filter
Compensation
Linear
Interpolation
Cancellation
Output
ARM_Y
ARM_Y
Y-Axis g-Cell
Clock CRC
Offset
Monitor
Scaling
Generation
Y-Axis Register
Array
SPI
Mismatch
Verification
Y-Axis
SPI
ΣΔ
Converter
Clock & bias
Generator
1 MHz
V REG
V REGA
V CC
SPI
CS
SCLK
Self
Test
Analog
Regulator
1 MHz
8 MHz
Oscillator
Digital
Regulator
Voltage
Monitoring
OTP
Array
Memory
I/O
MOSI
Over-Damped
X-Axis g-Cell
V REGA
Clock & bias
Generator
ΣΔ
Converter
V REG
X-Axis Register
Array
X-Axis
MISO
Clock CRC
Generation
Clock
Monitoring
Offset
SPI
SINC Filter
IIR
Low-Pass Filter
Compensation
Linear
Interpolation
Monitor
Offset
Cancellation
Output
Scaling
ARM_X
ARM_X
Figure 3. Block Diagram
MMA68xx
Sensors
Freescale Semiconductor, Inc.
3
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